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SystemVerilogによるモデリングと論理合成 ハードウェア記述言語による回路設計の基礎 篠塚 一也/著

著者名
共立出版 東京 2026.1 26cm 12,227p ¥¥4600
出版者
分類:549.7
SystemVerilogによるモデリングと論理合成      ハードウェア記述言語による回路設計の基礎
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蔵書情報

資料情報
所蔵数 1 在庫数 1 予約数 0

書誌詳細

内容紹介
ハードウェア記述言語としてSystemVerilogを採用し、回路設計をするために必要な基礎知識と基礎技術を解説する。SystemVerilogによる適切なRTL表現を準備する習慣が自然と身に付くテキスト。
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タイトルコード
1001111805966
書誌種別
図書(和書)
著者名
篠塚 一也/著
著者名ヨミ
シノズカ カズヤ
出版者
共立出版
出版年月
2026.1
ページ数
12,227p
大きさ
26cm
ISBN
4-320-12592-6
分類記号
549.7
書名
SystemVerilogによるモデリングと論理合成 ハードウェア記述言語による回路設計の基礎
書名ヨミ
システム ヴェリログ ニ ヨル モデリング ト ロンリ ゴウセイ
副書名
ハードウェア記述言語による回路設計の基礎
副書名ヨミ
ハードウェア キジュツ ゲンゴ ニ ヨル カイロ セッケイ ノ キソ
著者紹介
名古屋大学理学研究科数学研究生修了。自社アートグラフィックスのEDA製品開発を担当。著書に「実践UVM入門」など。
件名1
ハードウェア記述言語

資料情報

1
所蔵館 
中央 
資料種別 
一般図書 
配架場所 
新刊棚1 
状態 
在庫 
資料番号 
1218383261 
請求記号 
549.7/シノ/ 
帯出区分 
通常貸出 
貸出 
○ 

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